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CXAD33114A CXAD33114B是16位双通道125 MSPS的模数转换器ADC双通道ADC内核采用多级差分流水线架构每个ADC均具有宽带宽差分采样保持模拟输入放大器设置与控制的编程利用三线式SPI兼容型串行接口来完成
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CXAD33114A CXAD33114B是一款16位、双通道、125 MSPS的模数转换器(ADC),旨在支持需要高性能、低成本、小尺寸且具多功能性的通信应用。这款双通道ADC内核采用多级、差分流水线架构。每个ADC均具有宽带宽、差分采样保持模拟输入放大器,支持用户可选的各种输入范围。集成基准电压源可简化设计。占空比稳定器可用来补偿ADC时钟占空比的波动,使转换器保持出色的性能。SYNC输入允许多个芯片的同步。需要时,灵活的掉电选项可以明显降低功耗。 采用1.8 V单电源供电,数字输出驱动器则采用独立电源供电,以支持1.8 V CMOS或LVDS输出。 设置与控制的编程利用三线式SPI兼容型串行接口来完成。 CXAD33114A CXAD33114B采用64引脚QFN封装,额定温度范围为−55°C至+125°C。
最高采样速率:125 MSPS
信噪比(SNR):77.5dBFS @ 10MHz and 125MSPS
无杂散动态范围(SFDR):90dBc @ 10MHz and 125MSPS
中频采样频率可达 300MHz
1.8V 单电源供电
低功耗:796mW (125 MSPS)
1.8V CMOS或LVDS输出
1至8整数输入时钟分频器
集成ADC时钟占空比稳定器
多芯片同步功能
可编程ADC内部基准电压源
灵活的模拟输入范围:1.0V峰峰值至2.0V峰峰值
节能的掉电模式
大于90dB的通道隔离度
串行端口控制

CXAD33114A  CXAD33114B是16位双通道125 MSPS的模数转换器ADC双通道ADC内核采用多级差分流水线架构每个ADC均具有宽带宽差分采样保持模拟输入放大器设置与控制的编程利用三线式SPI兼容型串行接口来完成
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产品简介

目录

1.产品概述       2.产品特点     gI6嘉泰姆

3.应用范围       4.技术规格书下载(PDF文档)gI6嘉泰姆

5.产品封装       6.电路原理图  gI6嘉泰姆

7.相关产品gI6嘉泰姆

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         CXAD33114A CXAD33114B是一款16位、双通道、125 MSPS的模数转换器(ADC),旨在支持需要高性能、低成本、小尺寸且具多功能性的通信应用。这款双通道ADC内核采用多级、差分流水线架构。每个ADC均具有宽带宽、差分采样保持模拟输入放大器,支持用户可选的各种输入范围。集成基准电压源可简化设计。占空比稳定器可用来补偿ADC时钟占空比的波动,使转换器保持出色的性能。SYNC输入允许多个芯片的同步。需要时,灵活的掉电选项可以明显降低功耗。 采用1.8 V单电源供电,数字输出驱动器则采用独立电源供电,以支持1.8 V CMOS或LVDS输出。 设置与控制的编程利用三线式SPI兼容型串行接口来完成。 CXAD33114A CXAD33114B采用64引脚QFN封装,额定温度范围为−55°C至+125°C。

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最高采样速率:125 MSPSgI6嘉泰姆

信噪比(SNR):77.5dBFS @ 10MHz and 125MSPSgI6嘉泰姆

无杂散动态范围(SFDR):90dBc @ 10MHz and 125MSPSgI6嘉泰姆

中频采样频率可达 300MHzgI6嘉泰姆

1.8V 单电源供电gI6嘉泰姆

低功耗:796mW (125 MSPS)gI6嘉泰姆

1.8V CMOS或LVDS输出gI6嘉泰姆

1至8整数输入时钟分频器gI6嘉泰姆

集成ADC时钟占空比稳定gI6嘉泰姆

多芯片同步功能gI6嘉泰姆

可编程ADC内部基准电压源gI6嘉泰姆

灵活的模拟输入范围:1.0V峰峰值至2.0V峰峰值gI6嘉泰姆

节能的掉电模式gI6嘉泰姆

大于90dB的通道隔离度gI6嘉泰姆

串行端口控制gI6嘉泰姆

与AD9268系列引脚兼容gI6嘉泰姆

   应用范围 返回TOPgI6嘉泰姆


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电路原理图 返回TOPgI6嘉泰姆


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高速高精度ADC系列(ADC)gI6嘉泰姆

Part No.gI6嘉泰姆

分辨率gI6嘉泰姆

采样率gI6嘉泰姆

通道数gI6嘉泰姆

INLgI6嘉泰姆

DNLgI6嘉泰姆

满幅输入范围gI6嘉泰姆

SNRgI6嘉泰姆

SFDRgI6嘉泰姆

Power ConsumptiongI6嘉泰姆

数据gI6嘉泰姆

输出接口gI6嘉泰姆

PackagegI6嘉泰姆

CXAD33112AgI6嘉泰姆

14bitgI6嘉泰姆

125gI6嘉泰姆

2gI6嘉泰姆

±2LSBgI6嘉泰姆

±0.25LSBgI6嘉泰姆

2gI6嘉泰姆

76dBFSgI6嘉泰姆

>85dBcgI6嘉泰姆

796mWgI6嘉泰姆

CMOS/LVDSgI6嘉泰姆

QFN64gI6嘉泰姆

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155gI6嘉泰姆

2gI6嘉泰姆

±2LSBgI6嘉泰姆

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75.5dBFSgI6嘉泰姆

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820mWgI6嘉泰姆

CMOSgI6嘉泰姆

QFN64gI6嘉泰姆

CXAD33112CgI6嘉泰姆

14bitgI6嘉泰姆

80gI6嘉泰姆

2gI6嘉泰姆

±1.5LSBgI6嘉泰姆

±0.5LSBgI6嘉泰姆

2gI6嘉泰姆

76.5dBFSgI6嘉泰姆

>88dBcgI6嘉泰姆

477mWgI6嘉泰姆

CMOS/LVDSgI6嘉泰姆

QFN64gI6嘉泰姆

CXAD33113AgI6嘉泰姆

14bitgI6嘉泰姆

125gI6嘉泰姆

4gI6嘉泰姆

±2LSBgI6嘉泰姆

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2gI6嘉泰姆

76.4dBFSgI6嘉泰姆

>84.4dBcgI6嘉泰姆

580mWgI6嘉泰姆

Serial LVDSgI6嘉泰姆

QFN48gI6嘉泰姆

CXAD33113BgI6嘉泰姆

14bitgI6嘉泰姆

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76.6dBFSgI6嘉泰姆

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Serial LVDSgI6嘉泰姆

QFN48gI6嘉泰姆

CXAD33114AgI6嘉泰姆

16bitgI6嘉泰姆

125gI6嘉泰姆

2gI6嘉泰姆

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2gI6嘉泰姆

77dBFSgI6嘉泰姆

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796mWgI6嘉泰姆

CMOS/LVDSgI6嘉泰姆

QFN64gI6嘉泰姆

CXAD33114BgI6嘉泰姆

16bitgI6嘉泰姆

80gI6嘉泰姆

2gI6嘉泰姆

±4.5LSBgI6嘉泰姆

±0.5LSBgI6嘉泰姆

2gI6嘉泰姆

77.5dBFSgI6嘉泰姆

>90dBcgI6嘉泰姆

477mWgI6嘉泰姆

CMOS/LVDSgI6嘉泰姆

QFN64gI6嘉泰姆

CXAD33115AgI6嘉泰姆

16bitgI6嘉泰姆

125gI6嘉泰姆

4gI6嘉泰姆

±2.2LSBgI6嘉泰姆

±0.25LSBgI6嘉泰姆

2.8gI6嘉泰姆

81.1dBFSgI6嘉泰姆

>94.7dBcgI6嘉泰姆

832mWgI6嘉泰姆

JESD204BgI6嘉泰姆

QFN56gI6嘉泰姆

CXAD33115BgI6嘉泰姆

16bitgI6嘉泰姆

125gI6嘉泰姆

4gI6嘉泰姆

±4.5LSBgI6嘉泰姆

±0.7LSBgI6嘉泰姆

2gI6嘉泰姆

78.6dBFSgI6嘉泰姆

>90dBcgI6嘉泰姆

630mWgI6嘉泰姆

Serial LVDSgI6嘉泰姆

QFN48gI6嘉泰姆